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　　　　　　　主　　　文
原告の請求を棄却する。
訴訟費用は原告の負担とする。
　　　　　　　事　　　実
第一　当事者の求めた裁判
一　原告
　「特許庁が昭和五六年審判第一六三九二号事件について昭和六三年九月八日にし
た審決を取り消す。訴訟費用は被告の負担とする。」との判決
二　被告
　主文同旨の判決
第二　請求の原因
一　特許庁における手続の経緯
　原告は、昭和五一年九月七日、名称を「アナログ演算装置」とする発明（以下
「本願発明」という。）について特許出願（昭和五一年特許願第一〇七〇七四号）
をしたところ、昭和五六年五月二八日拒絶査定があつたので、同年八月一二日審判
を請求し、昭和五六年審判第一六三九二号事件として審理された結果、昭和六一年
一月二三日、「本件審判の請求は、成り立たない。」との審決（以下「前審決」と
いう。）がなされた。
　そこで、原告は、昭和六一年三月二五日東京高等裁判所に前審決の取消訴訟を提
起し、同裁判所昭和六一年（行ケ）第六三号事件として審理され、昭和六二年一二
月二二日前審決取消の判決（以下「前訴判決」という。）があり、右判決は確定し
たので、特許庁は前記審判事件について更に審理の上、昭和六三年九月八日、「本
件審判の請求は、成り立たない。」との審決（以下「本件審決」という。）をし、
その謄本は同年一〇月五日原告に送達された。
二　本願発明の要旨
①　入力アナログ信号を一つの入力とする比較器
②　プログラムメモリ部と演算制御部とデータメモリ部とを有し前記比較器からの
出力信号を入力とするプロセツサ
③　このプロセツサから出力されるデイジタル信号をアナログ信号に変換しかつこ
のアナログ信号を前記比較器の他の一つの入力信号として与えるデイジタルアナロ
グ変換器
④　このデイジタルアナログ変換器の出力信号を前記プロセツサからの出力指令信
号に従つてサンプル・ホールドするアナログ信号保持手段を具備し
⑤　前記プロセツサは、前記プログラムメモリ部に記憶されている信号に従つて前
記比較器、プロセツサ及びデイジタルアナログ変換器で構成されるループによつて
前記入力アナログ信号をデイジタル信号に変換し
⑥　次にこのデイジタル信号に前記データメモリ部及び又はプログラム部に記憶さ
れているデータを使用して所定の演算を施し
⑦　この演算結果を前記デイジタルアナログ変換器を介して前記アナログ信号保持
回路に出力する動作をなすことを特徴とするアナログ演算装置（別紙図面（一）参
照）
三　本件審決の理由の要点
１　本願発明の要旨は、前項記載のとおりである。
２　原査定の拒絶理由の要点は、本願発明は本件出願前に頒布された刊行物である
「ＥＤＮ」一九七四年四月五日号第三四頁ないし第四〇頁（以下「第一引用例」と
いう。）、米国特許第三、七三一、三〇二号明細書（以下「第二引用例」とい
う。）に記載された発明に基づいて当業者が容易に発明をすることができたもので
あるから、特許法第二九条第二項の規定により特許を受けることができない、とい
うものである。
　第一引用例（別紙図面（二）参照）、特にＦｉｇ６（第三八頁）やＦｉｇ８（第
三九条）とそれらに関する説明文を参照すると、両図は明らかに同じシステムの一
部を記載したものであり、かつ次の（１）～（７）を構成に欠くことができない事
項とする発明を記載したものであることが認められる。すなわち、
（１）　入力アナログ信号（ＡＮＡＬＯＧ　ＩＮＰＵＴ）を一つの入力とする比較
器（ＡＮＡＬＯＧ　ＣＯＭＰＡＲＡＴＯＲ）。
（２）　比較器からの出力信号（ＳＥＮＳＥ１　ＬＩＮＥの信号）を入力とするデ
イジタルコンピユータ（「ＣＯＭＰＵＴＥＲ」及び入出力のための周辺回路である
「ＤＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」「ＣＨＡＮＮＥＬ　ＯＵＴＰＵＴ　
ＲＥＧＩＳＴＥＲ」「ＤＥＣＯＤＥＲ」等）。デイジタルコンピユータである以
上、プログラムメモリ部、演算制御部及びデータメモリ部として動作する機能部分
を有することは当然である。また、比較器の出力信号がデイジタルコンピユータの
入力として供給されることは、Ｆｉｇ６（ｂ）のデイジタルコンピユータが実行す
べきプログラムステツプとして「ＪＵＮＰ　ＯＮ　ＳＥＮＳＥ１＝ＦＡＬＳＥ　Ｔ
Ｏ　ＳＨＩＦＴ」があることから、明らかである。なお、比較器からの出力信号に
よつて、Ｆｉｇ６（ｃ）中の「Ｘ〉ＶＯＬＴＡＧＥ？」が判断され、その結果が
「ＹＥＳ」又は「ＮＯ」に相当する。
（３）　デイジタルコンピユータから出力されるデイジタル信号（Ｆｉｇ６（ａ）
の「ＤＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」の出力である「ＯＵＴＰＵＴ」又
はＦｉｇ６（ｂ）、（ｃ）中のＸの値）をアナログ信号（ＡＮＡＬＯＧ　ＯＵＴＰ
ＵＴ）に変換しかつこのアナログ信号を前記比較器の他の一つの入力信号として与
えるデイジタルアナログ変換器ＤＣＡ（以下、デイジタルアナログ変換器を「Ｄ／
Ａ変換器」、アナログデイジタル変換器を「Ａ／Ｄ変換器」という。）。
（４）　このＤ／Ａ変換器の出力信号を前記デイジタルコンピユータからの出力指
令信号（Ｆｉｇ８の「ＦＲＯＭ　ＣＯＭＰＵＴＥＲ」と表示された線から「ＣＨＡ
ＮＮＥＬ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」及び「ＤＥＣＯＤＥＲ」を介して各
「ＳＡＮＰＬＥ＆ＨＯＬＤ」に与えられる信号）に従つてサンプル・ホールドする
アナログ信号保持手段（ＳＡＭＰＬＥ＆ＨＯＬＤ）。
（５）　前記デイジタルコンピユータは、それが当然有するプログラムメモリ部に
記憶されている（ｉｍｂｅｄｄｅｄ）信号に従つて前記比較器、デイジタルコンピ
ユータ及びＤ／Ａ変換器で構成されるループ（Ｆｉｇ６（ｂ）又は（ｃ）に記載さ
れている。）によつて前記入力アナログ信号をデイジタル信号（前記（３）のＸの
最終値）に変換する。
（６）　デイジタルコンピユータである以上、当然に有する前記（２）のデータメ
モリ部又はプログラムメモリ部のデータを使用して、当然に所定の演算をすると認
められる（演算をすること自体は第一引用例第三六頁左欄第一四行や同頁右欄第一
三行「ｄａｔａ　ｗｈｉｃｈ　ｍｕｓｔ　ｂｅ　ｐｒｏｃｅｓｓｅｄ」など、論文
全体の趣旨から明らかである。）。演算のタイミングについては、前記（５）の変
換の次とならざるを得ない。
（７）　デイジタル信号を前記Ｄ／Ａ変換器ＤＣＡを介して前記アナログ信号保持
回路（ＳＡＭＰＬＥ＆ＨＯＬＤ）に出力する動作（ソフトウエアはＦｉｇ８（ｂ）
に記載されており、それは当然にプログラムメモリ部に記憶されていると認められ
る。）をなすことを特徴とする、コンピユータのためのＤ／Ａ及びＡ／Ｄインター
フエース。
　次に、第二引用例（別紙図面（三）参照）を参照すると、次の〔１〕～〔７〕を
構成に欠くことができない事項とする発明が記載されていることが認められる。す
なわち、
〔１〕　入力アナログ信号１８を一つの入力とする比較器１９。
〔２〕　メモリ部１１～１４を有し前記比較器からの出力信号を入力するコンピユ
ータ（１０及び周辺回路２２、２４、２５、２６）。メモリ部がプログラムやデー
タを記憶し、算術演算や論理演算をすることは、例えば第二欄第三一行ないし第三
欄第一二行に明記されている。
〔３〕　コンピユータから出力されるデイジタル信号をアナログ信号に変換しかつ
このアナログ信号を前記比較器の他の一つの入力信号として与えるスイツチ及び梯
子回路網２０。
〔４〕　このスイツチ及び梯子回路網の出力信号を前記コンピユータからの出力指
令信号（アキユムレータ１１及びメモリバツフアレジスタ１２からデコーダ２６、
出力選択ロジツク回路２５を介してマルチプレクサスイツチ２４に与えられる信
号）に従つてサンプル・ホールドするアナログ信号保持手段２４、２３。
〔５〕　前記コンピユータは、前記プログラムに従つて前記比較器、コンピユータ
及びスイツチ及び梯子回路網で構成されるループによつて前記入力アナログ信号を
デイジタル信号に変換する。
〔６〕　このデイジタル信号に前記データを使用して所定の算術演算や論理演算を
施す。これら演算のタイミングについては、前記〔５〕の変換以前は物理的に不可
能であるから、前記〔５〕の変換の次とならざるを得ない。
〔７〕　この演算結果（「ｃｏｍｐｕｔｅｄ　ｖａｌｕｅｓ」又は「ｃｏｍｐｕｔ
ｅｄ　ｒｅｓｕｌｔｓ」）を前期スイツチ及び梯子回路網を介して前記アナログ信
号保持回路に出力する動作をなすことを特徴とする、Ｄ／Ａ変換システム。
３　請求人（原告）は、審判請求理由中で、次の事項を主張した。
第一引用例について
（イ）　アナログ信号をデイジタル信号に変換する動作、デイジタル信号に所定の
演算を施す動作、及び演算結果を出力する動作を時分割で、しかもプログラムメモ
リからの信号に従つてすることについて、開示されていない。
（ロ）　比較器の出力（ＳＥＮＳＥ１　ＬＩＮＥ）がどこに結合されているのか不
明である。
（ハ）　プロセツサの外部に、「ＤＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」「Ｃ
ＨＡＮＮＥＬ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」「ＤＥＣＯＤＥＲ」を有してい
る。
第二引用例について、
（ニ）　ナンドゲート２２、ロジツク回路２５、デコーダ２６をプロセツサの外部
に有する。
（ホ）　動作がハードウエアによるシーケンス制御によるものであつて、プログラ
ムメモリ部に記憶されている信号によつて動作が遂行されるものでない。
　また、当審における昭和六三年二月二九日付け尋問書に対して、同年五月一二日
付け回答書で次のように回答した。
（ヘ）　審判請求の理由に関して回答を請求することは、行政事件訴訟法第三三条
の趣旨に反する。
（ト）　第一引用例の「ＳＥＮＳＥ１　ＬＩＮＥ」はアツプダウンカウンタに結合
されると見るのが自然である。
（チ）　本願発明は、特許請求の範囲に記載された「プロセツサは、前記プログラ
ムメモリ部に記憶されている信号に従つて前記比較器、プロセツサ及びＤ／Ａ変換
器で構成されるループによつて前記入力アナログ信号をデイジタル信号に変換し、
次にこのデイジタル信号に前記データメモリ部及び又はプログラムメモリ部に記憶
されているデータを使用して所定の演算を施し、この演算結果を前記Ｄ／Ａ変換器
を介して前記アナログ信号保持回路を出力する動作をなす」構成によつて、「動作
がすべてプログラムメモリ部からの信号によつて行う」ものであり、かつ「コンピ
ユータの外部に制御のための各回路を必要としない」ものである。
（リ）　明細書を補正する意思はない。
４　よつて審理するに、本願発明は各引用例記載の発明に基づいて当業者が容易に
発明をすることができたものといわざるを得ない。
すなわち、
　本願発明と第一引用例記載の発明とを構成要件ごとに対比すると、前者の①～⑤
及び⑦は後者の（１）～（５）及び（７）とそれぞれ実質的に同一である。また、
前者の⑥がプロセツサのプログラムメモリ部に記憶されている信号に従つて演算を
するのに対し後者の（６）では演算を制御する手段を特定していない点で相違する
が、コンピユータがそれが当然に有するプログラムメモリ部に記憶されている信号
に従つて演算をするように構成すること自体は当業者が普通に予測する事項であ
り、それをデイジタル信号の演算という動作に適用することに何ら困難性は認めら
れないから、前記相違点は当業者が容易に想到することができたものというほかな
い。さらに、すべての構成要件を総合的に対比するとともに、発明の目的効果の相
違について検討しても、両発明の間に当業者が容易に予測することができないよう
な相違点を見いだすことができない。
　次に、本願発明と第二引用例記載の発明とを構成要件ごとに対比すると、前者の
①～⑤及び⑦は後者の〔１〕～〔５〕及び〔７〕とそれぞれ実質的に同一である。
また、前者の⑥がプロセツサのプログラムメモリ部に記憶されている信号に従つて
演算をするのに対し後者の〔６〕では演算を制御する手段がプログラムメモリ部に
記憶されている信号であると特定していない点で相違するが、コンピユータがプロ
グラムメモリ部に記憶されている信号に従つて演算をするように構成すること自体
は当業者が普通に予測する事項であり、それをデイジタル信号の演算という動作に
適用することに何ら困難性は認められないから、前記相違点は当業者が容易に想到
することができたものというほかない。さらに、すべての構成要件を総合的に対比
するとともに、発明の目的効果の相違について検討しても、両発明の間に当業者が
容易に予測することができないような相違点を見いだすことができない。
　前記（イ）～（チ）についての判断（省略）
５　以上のとおり、本願発明は、第一引用例又は第二引用例記載の発明に基づいて
当業者が容易になし得たものと認められ、特許法第二九条第二項の規定により特許
を受けることができない。
四　本件審決の取消事由
　本件審決は、前訴判決の拘束力がある判断に反してなされたものであり、かつ本
件審判手続において、本願発明が第一引用例又は第二引用例記載の発明に基づき容
易になし得たもので特許法第二九条第二項の規定により特許を受けることができな
い点を理由とする拒絶理由通知を発することなくなされたものであつて、違法とし
て取り消されるべきである。また、第一引用例記載の発明の構成（１）と本願発明
の構成①が実質的に同一であること、及び第一引用例記載の発明の構成（６）と本
願発明の構成⑥とが相違すること、第二引用例記載の発明の構成〔１〕、〔３〕、
〔７〕と本願発明の構成①、③、⑦が実質的に同一であること、及び第二引用例記
載の発明の構成〔６〕と本願発明の構成⑥とが相違すること並びに相違点の判断は
争わないが、本件審決は第一引用例及び第二引用例記載の技術内容を誤認した結
果、第一引用例記載の発明の構成（２）ないし（５）、（７）と本願発明の構成②
ないし⑤、⑦が一致すると誤つて認定し、かつ両者の相違点の判断を誤り、また、
第二引用例記載の発明の構成〔２〕、〔４〕、〔５〕と本願発明の構成②、④、⑤
が一致すると誤つて認定したものであるから、違法として取り消されるべきであ
る。
１　前訴において、第一引用例及び第二引用例は、それぞれ周知例１及び周知例２
として審理判断の対象となり、原告も被告もこれらの周知例１及び周知例２につい
て意見を述べる機会が十分与えられ、意見を主張してきている。
　東京高等裁判所は、これらの主張を審理判断し、「周知例１及び周知例２にＤ／
Ａ変換器をＡ／Ｄ変換系とＤ／Ａ変換系に共用する考え方が示されている」旨認定
した上で、「本願発明は引用例（本訴甲第五号証、以下「前引用例」という。）に
記載された発明に基づいて当業者が容易になし得たものと判断した前審決は違法で
ある。」旨判決したものである。
　そうすると、被告は、前訴判決の確定により、前引用例はもちろん、判決の中で
審理の対象として用いられた第一引用例及び第二引用例についても拘束を受けるの
が相当である。
　しかるに、本件審決は、前訴において既に審理が尽された第一引用例及び第二引
用例を再び用いて本願発明は第一引用例又は第二引用例記載の発明に基づいて当業
者が容易になし得たものと審決したもので、前訴判決に示された拘束力ある判断に
従つておらず、行政事件訴訟法第三三条第一項の規定に反し違法である。
２　前審決は、第一引用例と第二引用例とを用いて行つた拒絶査定について審理
し、新しい前引用例を加えて、「本願発明は、引用例に記載された発明に基づいて
当業者が容易になし得たものと認められる」旨の判断をしたものであり、前審決に
よれば、本願発明は、審査の段階で引用された第一引用例及び第二引用例の記載だ
けでは、すなわち、審査の段階の拒絶理由では、本願発明を拒絶査定することが困
難であるとの判断を行つたものであり、この段階で審査官による拒絶理由は、破棄
されたと解するのが自然である。
　そして、前審決が取り消された後の本件審決において、前審決の前述の判断を翻
し、「第一引用例及び第二引用例だけで、本願発明は当業者が容易になし得たもの
と認められる」との理由、及び「前審決とは引用事項及び引用の趣旨が相違する」
との理由により本願を拒絶したのであるから、全体の審査の流れを考慮すれば、特
許法第一五九条第二項で準用する同法第五〇条の規定により、出願人である原告に
対して、新たな拒絶理由通知を発し、意見書の提出及び補正の機会を改めて与えな
ければならないにもかかわらず、本件審判手続においてかかる手続を履践しなかつ
たのは違法である。
　確かに、被告から昭和六三年二月二九日付け尋問書が発せられ、原告も同年五月
一二日付け回答書により返答しているが、尋問書は法律の規定に存在しない手続で
あり、これに対する対応と、法律に規定されている拒絶理由書に対する出願人の対
応とは全く異なるもので、これをもつて拒絶理由通知をする意味がないとはいえな
い。
３　第一引用例には、本件審決認定の構成（２）ないし（５）及び（７）が記載さ
れていないから、これらの構成と本願発明の構成②ないし⑤及び⑦が実質的に同一
であり、両者はこの点において一致するとした本件審決の認定は誤りである。すな
わち、
　第一引用例記載の発明の構成（２）について
　本件審決は、第一引用例には、「比較器からの出力信号（ＳＥＮＳＥ１　ＬＩＮ
Ｅ　の信号）を入力するデイジタルコンピユータ（「ＣＯＭＰＵＴＥＲ」及び入出
力のための周知回路である「ＤＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」「ＣＨＡ
ＮＮＥＬ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」「ＤＥＣＯＤＥＲ」等）」が記載さ
れていると認定している。
　しかしながら、第一引用例のＦｉｇ６及び第三八頁の説明、Ｆｉｇ８及び第三九
頁の説明には比較器からの出力信号がどこに印加されているかの説明はなく、「Ｄ
ＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」等によりデイジタルコンピユータを構成
しているとの説明もない。Ｆｉｇ６及び第三八頁右欄第一六行ないし第一八行に
は、「出力レジスタ」と「比較器」だけを用いる旨説明されており、「出力レジス
タ（ＤＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ）」がデイジタルコンピユータに含
まれていないことは明確である。加えて、右出力レジスタには、「ＣＯＭＰＵＴＥ
Ｒ　ＯＵＴＰＵＴ　ＢＵＳ」からの信号以外に「ＲＥＧＩＳＴＥＲ　ＣＬＫ　ＳＩ
ＧＮＡＬ」も印加されており、これらの信号がどのように作用して「ＤＡＣ」への
「ＯＵＴＰＵＴ」を発生するかの説明もなされていないため、「出力レジスタ」か
らの出力と、「ＣＯＭＰＵＴＥＲ　ＯＵＴＰＵＴ　ＢＵＳ」からの信号との関係も
不明である。したがつて、本件審決の前記認定は誤りである。
　また、本件審決は、第一引用例記載の発明において、「比較器の出力信号がデイ
ジタルコンピユータの入力として供給されていることは、Ｆｉｇ６（ｂ）のデイジ
タルコンピユータが実行すべきプログラムステツプとして、「ＪＵＮＰ　ＯＮ　Ｓ
ＥＮＳＥ１＝ＦＡＬＳＥ　ＴＯ　ＳＨＩＦＴ」があることから、明らかである」旨
認定している。
　しかしながら、この命令は、単に（ｃ）に示すフローチヤートを実現するシステ
ム全体のプログラムを記述したにすぎず、このようなステツプがあるからといつて
直ちに比較器の出力信号がデイジタルコンピユータの入力として供給されているこ
とには結びつかないから、本件審決の右認定は誤りである。
　さらに、本件審決は、第一引用例記載の発明においては、「比較器からの出力信
号によつて、Ｆｉｇ６（ｃ）中の「Ｘ〉ＶＯＬＴＡＧＥ？」が判断され、その結果
が「ＹＥＳ」又は「ＮＯ」に相当する」旨認定しているが、「Ｘ〉ＶＯＬＴＡＧ
Ｅ？」の判断をしているのは比較器であるから右認定は誤りである。
　第一引用例記載の発明の構成（３）について
　第一引用例記載の発明には、Ｄ／Ａ変換器はあるが、Ｄ／Ａ変換器はレジスタか
らの信号を入力していてプロセツサからの信号を入力するものではないから、構成
（３）についての本件審決の認定は誤りである。
　第一引用例記載の発明の構成（４）について
　本件審決は、第一引用例記載の発明において、「ＦＲＯＭ　ＣＯＭＰＵＴＥＲ」
と表示された線が「ＣＨＡＮＮＥＬ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」及び「Ｄ
ＥＣＯＤＥＲ」を介して「ＳＡＭＰＬＥ＆ＨＯＬＤ」につながつていることを根拠
にして「アナログ信号保持手段」が「Ｄ／Ａ変換器からの出力信号をコンピユータ
からの出力指令信号に従つてサンプル・ホールドする」旨認定している。
　しかしながら、本願発明において、「プロセツサからの出力指令信号に従つてサ
ンプル・ホールドする」の意味するところは、プロセツサがＤ／Ａ変換器の出力信
号をサンプル・ホールドするタイミングを直接制御することを意味する（本願明細
書第一〇頁第八行ないし第一四行及び別紙図面（一）第２図（ヘ）参照）。しかる
に、第一引用例記載の発明は、「ＦＲＯＭ　ＣＯＭＰＵＴＥＲ」と表示された線か
らの信号がいつたん「ＣＨＡＮＮＥＬ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」で保持
され、そこから「アナログマルチプレクサ」、「デコーダ」及び「プログラマブル
ゲインアンプ」に信号が分配され、デコーダはこの信号を受けるとともに、コント
ロールアウトプツト２の信号を受けて各アナログ信号保持手段へサンプリングパル
スを出力するような構成であり、「ＦＲＯＭ　ＣＯＭＰＵＴＥＲ」と表示された線
からの信号と「ＳＡＭＰＬＥ＆ＨＯＬＤ」に印加されている「ＤＥＣＯＤＥＲ」か
らのサンプリングパルスとは一対一に対応していないことは明らかであるから、本
件審決の前記認定は誤りである。
　第一引用例記載の発明の構成（５）について
　本件審決は、第一引用例記載の発明の「デイジタルコンピユータは、それが当然
有するプログラムメモリ部に記憶されている信号に従つて比較器、Ｄ／Ａ変換器で
構成するループによつて入力アナログ信号をデイジタル信号に変換する」旨認定し
ているが、「デイジタルコンピユータ」がどのような形でループに入つているのか
不明であるし、コンピユータとは別の「ＤＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥ
Ｒ」が介在しているから、右認定は誤りである。
　第一引用例記載の発明の構成（７）について
　本件審決は、第一引用例記載の発明の「デイジタルコンピユータは、デイジタル
信号をＤ／Ａ変換器（ＤＣＡ）を介してアナログ信号保持回路に出力する動作（ソ
フトウエアはＦｉｇ８（ｂ）に記載されており、それは当然にプログラムメモリ部
に記憶されていると認められる。）をなしている」旨認定しているが、右認定の根
拠となつているＦｉｇ８（ｂ）にはそれを示唆するようなステツプは記載されてい
ないから、誤りである。
　また、本願発明の構成⑥と第一引用例記載の発明の構成（６）が相違することは
本件審決認定のとおりである。
　そして、以上の構成の相違により、本願発明は、動作のすべてがプログラムメモ
リ部からの信号によつて行われ、プロセツサの外部にＡ／Ｄ変換器やその他制御の
ための各回路（ハードウエア）を必要としないので、全体構成を簡単にかつ安価に
できるという作用効果がある（本願明細書第一〇頁第一九行ないし第一一頁第五
行）のに対して、第一引用例記載の発明は、ハードウエアの比較においてもプロセ
ツサの外部に「各種のレジスタ」や「デコーダ」を使用しており、構成が複雑で高
価になるという相違がある。
　したがつて、本願発明は第一引用例記載の発明から当業者が容易に推考できたも
のに該当しない。
４　第二引用例のＦＩＧ１（別紙図面（三）参照）には「Ｄ／Ａ変換システム」の
全体のブロツク図が示され、このシステムは、比較器１９、破線で囲まれた部分か
ら成るコンピユータ１０、Ｄ／Ａ変換器（スイツチ及び梯子回路網）２０、該Ｄ／
Ａ変換器２０からのアナログ信号を出力選択ロジツク回路２５からの信号でサンプ
リングするストレージユニツト２３等で構成される回路であることが示されている
が、第二引用例には、本件審決認定の構成〔２〕、〔４〕及び〔５〕が記載されて
いないから、これらの構成と本願発明の構成②、④及び⑤が実質的に同一であり、
両者はこの点において一致するとした本件審決の認定は誤りである。すなわち、
　第二引用例記載の発明の構成〔２〕について
　本件審決は、第二引用例には、「比較器からの出力信号を入力とするコンピユー
タ（１０及び周辺回路２２、２４、２５、２６）」が記載されていると認定してい
る。
　しかしながら、第二引用例の第二欄第三一行ないし第三三行には、ＦＩＧ１の破
線で囲まれた矩形部分がコンピユータであると明記されているから、周辺回路２
２、２４、２５、２６をコンピユータに含めているのは誤りである。本願発明にお
いて「プロセツサ」は、小形化された「マイクロコンピユータ」を想定しており
（本願明細書第三頁第一六行ないし第四頁第一九行）、プロセツサ２０の外部にど
のようなハードウエアを配置させるかは、全体構成を簡単でかつ安価にすることを
目的とした本願発明においては、特に重要な判断事項である。
　また、第二引用例記載の発明は、プロセツサに相当するものがあることは認めら
れるが、比較器からの信号を入力していない。このことは、第二引用例記載の発明
には、Ｄ／Ａ変換動作を、どのタイミングで開始するかを決定する重要な役目をし
ているナンドゲート２２があることから明らかである。加えて、第二引用例第七欄
及び第八欄記載の「コンピユータプログラム」は、アナログ入力の値をデイジタル
値に変換するためのサブルーチンを示していて、装置全体の動作を示すプログラム
ではない。
　したがつて、本件審決の前記認定は誤りである。
　第二引用例記載の発明の構成〔４〕について
　本件審決は、第二引用例記載の発明において「アキユムレータ１１及びメモリバ
ツフアレジスタ１２からの信号がデコーダ２６、出力選択ロジツク回路２５を介し
てマルチプレクサスイツチ２４に与えられていること」を根拠にして、「アナログ
信号保持手段２４、２３」が「スイツチ及び梯子回路網２０の出力信号をコンピユ
ータからの出力指令信号に従つてサンプル・ホールドする」旨認定している。
　しかしながら、第二引用例記載の発明は、デコーダ２６や出力選択ロジツク回路
２５、マルチプレクサスイツチ２４により、スイツチ及び梯子回路網２０からの信
号をアナログ信号保持手段２３に印加するような構成であり、本願発明のように、
コンピユータから直接出力される出力指令信号（サンプリングパルス）によりＤ／
Ａ変換器からの出力をアナログ信号保持手段に印加する構成となつていない。
　また、信号の経路の途中にデコーダ、出力選択ロジツク回路、マルチプレクサス
イツチ等が存在すれば動作のタイミングや信号形態が本願発明と異なるものになる
ことは常識的なことである。
　したがつて、本件審決の前記認定は誤りである。
　第二引用例記載の発明の構成〔５〕について
　本件審決は、第二引用例記載の発明において、「コンピユータは、プログラムに
従つて比較器、コンピユータ及びスイツチ及び梯子回路網で構成されているループ
によつて入力アナログ信号をデイジタル信号に変換する」旨認定している。
　しかしながら、第二引用例記載の発明においては、比較器１９の出力信号が外部
からのタイミングパルスによりその開閉が制御されるナンドゲート２２を介してコ
ンピユータ１０に印加されており、比較器１９からの出力信号は端子１７に印加さ
れる外部タイミングパルスによつてコンピユータ１０に印加される構成であつて、
Ａ／Ｄ変換の動作がプログラムに従つて行われているとはいえない。ナンドゲート
２２は、単なる信号の通りみちとしての機能だけでなく、Ａ／Ｄ変換動作をどのタ
イミングで開始するかを決定する手段として重要な役目をしている。
　したがつて、本件審決の前記認定は誤りである。
　そして、以上の構成の相違により、本願発明は、前述のとおり、動作のすべてが
プログラムメモリ部からの信号によつて行われ、プロセツサの外部にＡ／Ｄ変換器
やその他制御のための各回路を必要としないので、全体構成を簡単かつ安価にでき
るという作用効果があるのに対して、第二引用例記載の発明は、動作の一部がプロ
セツサの外部に設けたナンドゲート２２やデコーダ２６、出力選択ロジツク回路２
５によるもので、構成が複雑で高価になるという作用効果上の差異がある。
　したがつて、本願発明は、第二引用例記載の発明から当業者が容易に推考できた
ものに該当しない。
第三　請求の原因に対する認否及び被告の主張
一　請求の原因一ないし三の事実は認める。
二　同四は争う。審決の認定、判断は正当であり、審決に原告主張の違法はない。
１　前審決は、本願発明は前引用例記載の発明に基づいて当業者が容易になし得た
としたもので、その際第一引用例及び第二引用例を本願発明の構成⑤及び⑦に関連
し、参考としていずれも断片的に引用したにすぎない。
　一方、本件審決は、第一引用例及び第二引用例を主引用例とし、本願発明の構成
①ないし⑦のすべてに対応する事項を引用し、それぞれ本願発明と総合的に対比し
たもので、前審決とは第一引用例及び第二引用例の引用事項及び引用の趣旨が相違
するから、本件審決に原告主張の違法はない。
２　本件審決は、審査における査定と同一の引用例及び同一の理由によつて本願発
明は特許を受けることができないとしたものであり、審査においてした手続である
拒絶理由通知及び拒絶査定は、特許法第一五八条の規定により審判においてもその
効力を有し、同法第一五九条第二項の規定による再度の拒絶理由通知を要しないか
ら、本件審判手続には同法第五〇条に違反する違法はない。
　なお、本件審判手続において、原告に対し、昭和六三年二月二九日付け尋問書に
より原査定に不服の理由及び明細書を補正する意思の有無をたずねたところ、原告
は、同年五月一二日付け回答書により回答し、あわせて、明細書を補正する意思は
ないと述べており、原告に対して、審査における査定の理由と同一の拒絶理由を再
度通知する意味は全くない。
３　第一引用例記載の技術内容は、本件審決認定のとおりであつて、右認定に原告
主張の誤りはない。
　第一引用例記載の発明の構成（２）について
　比較器からの出力信号（ＳＥＮＳＥ１　ＬＩＮＥ）がコンピユータに入力される
ことは、第一引用例の第三八頁Ｆｉｇ６のプログラム及び同図の説明から明らかで
ある。
　また、第一引用例のＦｉｇ６（ｂ）（ｃ）のプログラムは、同図欄外の説明文
「連続近似論理はコンピユータサブルーチンに記憶される」と明記されているとお
り、コンピユータの中に存在する。そして、右プログラム中には、「ＪＵＮＰ　Ｏ
Ｎ　ＳＥＮＳＥ１＝ＦＡＬＳＥ　ＴＯ　ＳＨＩＦＴ」（センス一ラインが偽なら　
ＳＨＩＦＴ　へ飛べ）の命令がある以上ＳＥＮＳＥ１　ＬＩＮＥの信号（比較器の
出力信号）がコンピユータ内で処理されること、その処理のためにコンピユータに
入力されることは当然である。
　さらに、「Ｘ〉ＶＯＬＴＡＧＥ？」の判断は、比較器の出力信号がコンピユータ
に入力され、実行される。コンピユータはＦｉｇ６（ａ）の回路中には図示されて
いないが、「ＳＥＮＳＥ１　ＬＩＮＥ」及び「ＣＯＭＰＵＴＥＲ　ＯＵＴＰＵＴ　
ＢＵＳ」に接続されており、Ｆｉｇ６（ｃ）のフローチヤートのプログラムを
（ａ）に示された回路のみが実行することはあり得ない。
　第一引用例記載の発明の構成（３）について
　第一引用例記載の発明において、コンピユータからの出力信号がＤ／Ａ変換器に
入力されることは、本件審決認定のとおりである。
　第一引用例記載の発明の構成（４）について
　第一引用例記載の発明の「ＣＨＡＮＮＥＬ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」
「アナログマルチプレクサ」「デコーダ」「プログラマブルゲインアンプ」は入出
力装置の一部であり、いわば信号の単なる通りみちにすぎず、アナログ信号保持手
段がＤ／Ａ変換器からの出力信号をコンピユータの指令に従つてサンプル・ホール
ドする旨の本件審決の認定を左右するものではない。
　第一引用例記載の発明の構成（５）について
　第一引用例記載の発明のループの形態は、Ｆｉｇ６（ａ）（ｂ）（ｃ）から一目
瞭然であり、「ＤＡＣ　ＯＵＴＰＵＴ　ＲＥＧＩＳＴＥＲ」は入出力装置の一部に
すぎず、右ループによりＡＤ変換が行われる旨の本件審決の認定を左右するもので
はない。
　第一引用例記載の発明の構成（７）について
　第一引用例のＦｉｇ８（ａ）の回路によれば、「ＤＡＣ」の出力は「ＳＡＭＰＬ
Ｅ＆ＨＯＬＤ」に接続されており、またＦｉｇ８（ｂ）には「アナログ出力命令」
や「アナログ値をＸに置け。ＸをＤＣＡのレジスタに出力せよ。」のステツプが記
載されており、演算結果をＤ／Ａ変換器を介してアナログ信号保持回路に出力する
ことが明らかである。
　そして、本願発明は「動作のすべてが」「制御のための各回路（ハードウエア）
を必要としないこと」及び「外部に各種のレジスタやデコーダを使用しない」こと
を要旨とするものでなく、外部にＡ／Ｄ変換器を必要としないことは第一引用例記
載の発明も同じであるから、本願発明の作用効果が格別のものであるとすることは
できない。
４　第二引用例記載の技術内容は本件審決認定のとおりであつて、右認定に原告主
張の誤りはない。
　第二引用例記載の発明の構成〔２〕について
　本件審決が第二引用例記載の発明における汎用コンピユータ１０及び周辺回路２
２、２４、２５、２６を併せて「コンピユータ」としたのは、単なる呼称表現の問
題である。
　また、第二引用例の第七欄「コンピユータプログラム」中の「ＳＬＡ」には「ア
ナログ入力がアキユムレータの内容より大のときスキツプせよ」の命令が明記され
ており、比較器からの信号がコンピユータに入力され処理されていることは明白で
ある。
　第二引用例記載の発明の構成〔４〕について
　本願発明の特許請求の範囲には「Ｄ／Ａ変換器の出力信号をサンプル・ホールド
するタイミングを直接制御する」旨の記載はなく、このことは本願発明の要旨では
ない。
　一方、第二引用例記載の発明において、デコーダ、出力選択ロジツク回路、マル
チプレクサスイツチは出力のための付属的装置であり、いわば単なる信号の通りみ
ちにすぎず、Ｄ／Ａ変換器の出力信号をコンピユータの指令に従つてサンプル・ホ
ールドする旨の本件審決の認定を左右するものではない。コンピユータプログラム
の指定によつてＤ／Ａ変換器の出力信号がサンプル・ホールドされることは、第八
欄のコンピユータプログラム中の「ＯＵＴＰＵＴ」として「スイツチ及び梯子回路
網２０の出力をストレージユニツトに出力せよ」という命令が記載されていること
から明らかである。
　第二引用例記載の発明の構成〔５〕について
　第二引用例の「発明の簡単な説明」には、「私は、汎用コンピユータのプログラ
ムされたサブルーチンによつてＡ／Ｄ変換の動作を行うことができることを見いだ
した」（第一欄第一三行ないし第一七行）と記載され、第七欄、第八欄に右プログ
ラムが開示されているから、コンピユータがプログラムに従つてアナログ信号をデ
イジタル信号に変換していることは明らかである。第二引用例中のナンドゲート２
２は単なる信号の通りみちであり、本件審決の認定を左右するものではない。
　また、作用効果については、本願発明の特許請求の範囲には、「動作のすべ
て」、「制御のための各回路を必要としない」旨の記載はないから、このことは本
願発明の要旨ではない。
　原告は、第二引用例記載の発明には、ナンドゲート２２、デコーダ２６、出力選
択ロジツク回路２５があり複雑で高価になる旨主張するが、右ナンドゲート等に相
当するものは、本願発明でも使用している。すなわち、本願明細書に記載された本
願発明の実施例においても、入力ポート２１、出力ポート２５、割込み入力端子１
５が使用され、その具体的内容は省略されているが、それらの中にはゲートやデコ
ーダ等が当然に存在しており、したがつて、本願発明において制御のための各回路
を必要としないとの原告の主張は理由がなく、この点で第二引用例記載の発明に差
異は存しない。
第四　証拠関係（省略）
　　　　　　　理　　　由
一　請求の原因一（特許庁における手続の経緯）、二（本願発明の要旨）及び三
（本件審決の理由の要点）の事実は、当事者間に争いがない。
二　そこで、原告主張の審決の取消事由の存否について判断する。
１　原告は、本件審決は、前訴判決に示された拘束力ある判断に従つておらず、行
政事件訴訟法第三三条第一項の規定に反し違法である旨主張する。
　特許出願を拒絶する査定に対する不服の審判手続において特許庁審判官がした審
決に対する取消訴訟は行政事件訴訟法第三条第一項第二項所定の行政庁の処分の取
消しを求める訴訟であつて、右審決を取り消す判決は同法第三三条第一項の規定に
より、「その事件について、当事者たる行政庁その他の関係行政庁を拘束する」か
ら、更に審理を行う特許庁審判官は前審決を取り消した判決に拘束され、判決の理
由中の判断において否定された前審決の理由と同一の理由により前審決と同一の結
論の審決をすることは許されないが、前審決の理由とは別個の理由によつて再度前
審決と同一の結論の審決をすることは、判決が示した司法審査の範囲外のことであ
るから何ら妨げないことである。
　これを本件についてみるに、成立に争いのない甲第二号証によれば、前審決は
「パルス技術便覧（初版）」（日刊工業新聞社昭和四一年九月二〇日発行）第一〇
六一頁、第一〇六二頁を引用例（本判決における「前引用例」）とし、この前引用
例記載の技術事項を構成（１）ないし（７）に分説し、これと本願発明の構成①な
いし⑦（本判決における本願発明の要旨①ないし⑦と同一）とをそれぞれ対比し、
その間に格別の相違はなく、ただ本願発明は前引用例記載の発明における二種の変
形を同時に適用したものに相当するが、この同時適用を妨げる格別の理由なく、目
的効果についても当業者が予測し得ない相違は見いだせないから、本願発明は前引
用例記載の発明に基づいて当業者が容易になし得たものと認められ、特許法第二九
条第二項の規定により特許を受けることができないとの理由により拒絶査定に対す
る不服の審判請求を成り立たないとしたものであり、前訴判決は、その理由中にお
いて、前引用例記載の発明は本願発明の構成⑦を有しないものであり、その結果、
右発明の奏する作用効果も奏し得ないから、本願発明の構成②ないし⑥について前
引用例記載の発明と対比判断するまでもなく、本願発明は前引用例記載の発明に基
づいて当業者が容易になし得たものとした審決は違法であるから取消しを免れない
と判断して、前審決を取り消したことが認められる。
　これに対し、前記本件審決の理由の要点によれば、本件審決は、第一引用例記載
の技術内容を構成（１）ないし（７）に、第二引用例記載の技術内容を構成〔１〕
ないし〔７〕に分説し、これと本願発明の構成①ないし⑦とをそれぞれ対比し、
（１）ないし（５）及び（７）、〔１）ないし〔５〕及び〔７〕と、①ないし⑤及
び⑦とは一致し、（６）又は〔６〕と⑥とが相違するが、右相違点⑥の構成は当業
者が容易に想到することができたものとし、結局本願発明は第一引用例又は第二引
用例記載の発明に基づいて当業者が容易になし得たもので特許法第二九条第二項の
規定により特許を受けることができないとの理由により、再度本件審判請求を成り
立たないとしたものであることが認められ、本件審決の理由と前訴判決の理由とを
対比検討すれば、本件審決は前訴判決の理由中の判断において否定された前審決の
理由とは別個の理由によつて再度前審決と同一の結論の審決をしたものであるか
ら、前訴判決の拘束力に反するものということはできない。
　原告は、前訴において第一引用例及び第二引用例はそれぞれ周知例１及び周知例
２として審理判断の対象となり、原告被告共にこれについて意見を述べ、東京高等
裁判所はこれらの主張を審理判断した上で本願発明は前引用例記載の発明に基づい
て当業者が容易になし得たものと判断した前審決を違法と判決したのであるから、
本件審決がこれらを再度用いて本願発明は第一引用例又は第二引用例記載の発明に
基づいて当業者が容易になし得たと判断したのは、前訴判決に示された拘束力ある
判断に従つていない旨主張する。
　なるほど、前掲甲第二号証によれば、前審決及び前訴判決の理由中には、第一引
用例が周知例１、第二引用例が周知例２として摘示されていることが認められる。
しかしながら、前掲甲第二号証によれば、前審決は前引用例記載の技術内容を認定
するに当たり、前引用例記載の発明が構成（５）及び（７）を有することを認定す
るため本件出願当時の技術水準を明らかにする必要上周知例１及び周知例２を摘示
したにすぎず、前訴判決もその理由中において、本願発明の構成⑦に関連して周知
例１及び周知例２にＤーＡ変換器をＡーＤ変換系とＤーＡ変換系とに共用する考え
方が示されているとしても、前引用例にそのような考え方が示されていないこと等
を理由として、このことから前引用例記載の発明が本願発明の構成を有するものと
はできないと判断しているにとどまり、周知例１及び周知例２は前引用例記載の技
術内容を認定するための資料としてそのごく一部が判断の対象とされたにすぎない
ことが認められるから、その判断は本件審決において周知例１及び周知例２を第一
引用例及び第二引用例としこの刊行物記載の技術内容から本願発明の容易推考性を
判断することと何ら牴触するものではなく、原告の前記主張は採用できない。
　したがつて、本件審決には、前訴判決の拘束力に牴触し行政事件訴訟法第三三条
第一項の規定に違反した違法は存しない。
２　次に、原告は、本件審判手続において出願人である原告に対し、特許法第一五
九条第二項で準用する同法第五〇条の規定により、本願発明は第一引用例又は第二
引用例記載の発明に基づき当業者が容易になし得た旨の拒絶理由通知をなすべきで
あつたのにこの手続を履践しなかつたのは違法である旨主張する。
　特許庁審判官は、拒絶査定に対する不服の審判手続において、審査手続において
なされた拒絶理由に基づく拒絶査定の当否について判断すべきところ、拒絶査定に
掲げる理由とは異なる別個の拒絶の理由を発見したときは、新たな拒絶理由通知を
しなければならない（特許法第一五九条第二項、第五〇条）が、審判手続において
新たな拒絶理由通知をすると、もはや原査定の理由をもつて拒絶理由とすることが
許されなくなるものではない。けだし、特許出願についての審査手続と審判手続と
は出願から特許査定又は拒絶査定の確定に至るまでの手続として継続性を有し、特
許法第一五八条には、「審査においてした手続は、第一二一条第一項の審判におい
ても、その効力を有する」と規定されているから、審判手続において新たな拒絶理
由通知がなされたという一事をもつて、当然原査定の基になつた拒絶理由通知が失
効することにはならないし、拒絶理由通知は、出願人に対し特許出願を拒絶すべき
事由があることを通知することにより、出願人に意見の陳述の機会を与え（同法第
五〇条）、同時に右通知に対応した必要な補正をする機会を与えるものであり、特
定の理由による拒絶理由通知がなされているときは、既に出願人に意見の陳述と補
正の機会が与えられているのであるから、重ねて同一の理由を示して拒絶理由通知
をしなくても出願人の利益保護に欠けるところがないからである。
　これを本件についてみると、成立に争いのない乙第一、第二号証及び甲第七号証
によれば、特許庁審査官は、昭和五六年二月六日、原告に対し本願発明はその出願
前国内において頒布された第一引用例、第二引用例に記載された発明に基づいて当
業者が容易に発明をすることができたものと認められるから、特許法第二九条第二
項の規定により特許を受けることができない、との拒絶理由通知をしたこと、これ
に対し、原告は、本願発明が（ｉ）比較器、プロセツサ、Ｄ／Ａ変換器で構成され
るループによつて入力アナログ信号をデイジタル信号に変換する、（ｉｉ）このデ
イジタル信号に所定の演算を施す、（ｉｉｉ）演算結果をＤ／Ａ変換器を介してア
ナログ信号保持回路に出力する、ことを特徴とする等を記載した意見書を提出し、
同年四月一七日付け手続補正書により本願発明の特許請求の範囲を補正（その第一
項は本願発明の要旨記載のとおりである。）したこと、特許庁審査官は、同年五月
二八日、右意見書及び補正書を検討したが拒絶理由を覆すに足りる根拠が見いだせ
ないとの理由（備考欄において、出願人が本願発明の特徴点とする（ｉ）ないし
（ｉｉｉ）は第一引用例、第二引用例のいずれにも記載されていると付記）で本件
出願を拒絶すべきものとするとの査定をしたことが認められ、その後審判手続にお
いて、原告に対し本願発明は前引用例記載の発明に基づいて容易に発明をすること
ができたものとの拒絶理由通知がなされた上、前審決に至つたことは弁論の全趣旨
に徴し明らかである。
　そうであれば、前訴判決によつて前審決が取り消された結果、右判決の拘束力の
もとに更に審理を行う特許庁審判官が本願発明は第一引用例又は第二引用例記載の
発明に基づいて容易に発明をすることができたとの判断に到達した場合において、
重ねて右理由を示した拒絶理由通知を発することなく本件審決をしても手続上の瑕
疵があつたとはいえない。
　原告は、前審決によれば、本願発明は審査の段階で引用された第一引用例及び第
二引用例の記載だけでは、すなわち、審査の段階の拒絶理由では本願発明を拒絶査
定にすることが困難であるとの判断を行つたものであり、この段階で審査官による
拒絶理由は破棄されたと解するのが自然である旨主張するが、この主張を採用でき
ないことは前述したところから明らかである。もつとも、出願人としては、前審決
のなされる前の審判手続において新たな拒絶理由通知がなされ前審決がこれに基づ
く判断を示したことから、原査定の基になつた拒絶理由は失効されたものと誤認し
やすいことは否めないが、それだからといつて本件審判手続に原告主張の違法があ
るとすることはできない。しかも、成立に争いのない乙第三、第四号証によれば、
特許庁審判官は前訴判決確定後の昭和六三年二月二九日原告に対し尋問書を発し、
原査定に不服の理由として昭和五六年八月二七日付け審判理由補充書の主張に付加
する事項があれば述べられたい旨、具体的事項を摘示して回答を求めていること、
これに対し原告は昭和六三年五月一二日付け回答書で本件審決の理由の要点（ヘ）
ないし（リ）の趣旨の回答をしたことが認められるから、右のような誤認が生じな
いよう配慮した処置が講じられ、出願人の利益保護が十分になされているというこ
とができる。
　したがつて、本件審決には、特許法第一五九条第二項、第五〇条に規定する手続
を履践しなかつた違法は存しない。
３　原告は、本件審決は、第一引用例及び第二引用例記載の発明の技術内容を誤認
した結果、第一引用例記載の発明の構成（２）ないし（５）、（７）と本願発明の
構成②ないし⑤、⑦が一致すると誤つて認定し、かつ両者の相違点の判断を誤り、
また第二引用例記載の発明の構成〔２〕、〔４〕、〔５〕と本願発明の構成②、
④、⑤が一致すると誤つて認定したものである旨主張するところ、本件審決の理由
の要点によれば、本件審決は、本願発明は第一引用例又は第二引用例記載の発明に
基づいて当業者が容易に発明をすることができたとしたものであつて、第一引用例
又は第二引用例記載の発明のいずれかについて本件審決の判断を正当とするとき
は、本件審決には取り消すべき違法は存しないことに帰するから、まず第二引用例
記載の発明についての本件審決の認定、判断に原告主張の違法が存するかについて
検討する。
　成立に争いのない甲第六号証及び前掲甲第七号証によれば、本願明細書には、本
願発明の技術的課題（目的）、構成、及び作用効果について、次のとおり記載され
ていることが認められる。
（一）　本願発明は、アナログ信号を入力とし、加減演算乗除演算をはじめ各種の
演算をマイクロコンピユータ等のプロセツサを用いて行うようにしたアナログ演算
装置に関するもの（本願明細書第三頁第一二行ないし第一五行）であつて、マイク
ロコンピユータ等のプロセツサをアナログシステムに導入する場合、プロセツサの
入力側にＡ／Ｄ変換器を、出力側にＤ／Ａ変換器を設ける必要があるが、Ａ／Ｄ変
換器は回路構成が複雑で価格も高価であるため、Ａ／Ｄ変換器とマイクロコンピユ
ータとでシステムを構成すると、全体装置も複雑となり、その上高価となる欠点が
あり、特に入力信号が複雑になると、Ａ／Ｄ変換器を入力信号の数だけ設けるか、
あるいはマルチプレクサを設け複数の入力信号をここで切り換えた後Ａ／Ｄ変換す
る必要があつて、構成が著しく複雑となる欠点があつた（同第三頁第一六行ないし
第四頁第一四行）との知見に基づき、アナログ信号を入力としながらもプロセツサ
の入力側にＡ／Ｄ変換器やマルチプレクサ等を必要とせず、したがつて、全体構成
が簡単でかつ安価なアナログ演算装置を提供すること（同第四頁第一五行ないし第
一九行）を目的とするものである。
（二）　本願発明は、右目的を達成するため、特許請求の範囲第一項（本願発明の
要旨）記載の構成を採用した（昭和五六年四月一七日付け手続補正書三枚目第二行
ないし四枚目第三行）ものである。
（三）　本願発明は、前記構成を採用したことにより、プロセツサの入力側に高価
なＡ／Ｄ変換器を設ける必要がなく、全体構成を簡単かつ安価にできるものである
（本願明細書第一五頁第三行、第四行）。
　一方、成立に争いのない甲第四号証によれば、第二引用例記載の発明は、汎用の
デイジタルコンピユータを用いたＤ／Ａ変換システムに関する（ＡＢＳＴＲＡＣＴ
　第一行ないし第三行）ものであつて、アナログ入力を有するデイジタルコンピユ
ータは、通例かなり大規模なハードウエアを含む外部Ａ／Ｄ変換システムを使用
し、さらにいくつかのアナログ出力が必要である場合には、通例いくつかのデイジ
タル・レジスタが装備され、そのおのおのにはデイジタル数字をアナログ信号に変
換するための連結スイツチと梯子回路網が備えられていた（第一欄第三行ないし第
九行）が、第二引用例記載の発明は、アナログーデイジタル変換手順が外部デイジ
タル・レジスタ及び関連の制御論理を省くことを可能とする汎用コンピユータ内の
プログラムされたサブルーチンにより実行することが可能であるという知見に基づ
いてなされたもので、それによりコンピユータとともに用いるために装備しなけれ
ばならない外部装置のコストを大幅に節減できる（同欄第一三行ないし第一九行）
という作用効果を奏するもので、その構成を要約すると、次のとおりであることが
認められる（第一欄第二〇行ないし第二欄第一四行）。
（イ）　スイツチ及び梯子回路網がコンピユータ累算器のデイジタル出力をアナロ
グ形式に変換する。これは比較器によつて未知のアナログ入力と比較され、この比
較器の出力はコンピユータ上のスキツプ母線にゲートされる。
（ロ）　任意の数字、望ましくは最上位位置の一ビツトから始まつて比較器の出力
はアナログ入力が累算器に記憶されている数字よりも大きいか小さいかを指示す
る。もし小さい場合は、最上位ビツトは０に変化され、大きい場合は、スキツプ母
線が起動してコンピユータが最上位ビツトを０にクリヤする命令を飛び越すように
させ、その後、一ビツトが累算器レジスタの二番目の上位位置に挿入され、アナロ
グ入力と第二の比較がなされる。このプロセスは、累算器レジスタ内の最上位ビツ
トから最下位ビツトへと進行して、アナログ入力信号が累算器信号よりも大きい場
合は、ビツトを０にクリヤする命令を飛び越すようにさせる。
（ハ）　このような連続的な近似によつて、累算器のデイジタル出力はアナログ入
力信号と等価になる。このようにして、信号のデイジタル形式への変換は、外部ス
イツチと梯子回路網、比較器とゲートを用い、汎用コンピユータのサブルーチンを
利用して行われ、それにより外部レジスタ及び前記に必要なステツプを制御するた
めの論理システムが不要となる。
（ニ）　出力機能は直前に読み入れられた量に限定されるものでなく、計算結果を
出力することにも活用できる。
（ホ）　色層分析の場合のように一連のアナログ入力に関連してこのシステムを活
用するには、デイスプレイ媒体、作図装置又は他の装置で利用するため特定の値を
アナログ形式で出力するのが望ましく、この目的のため複数個の記憶装置を装備
し、その各々をマルチプレクサスイツチ装置を介してスイツチ及び梯子回路網に接
続する。
（ヘ）　数値をアナログ形式で出力するため、数値はまず累算器に装荷され、次に
マルチプレクサのスイツチの一つが特定の入力ー出力指令を実行することによつて
選択される。この指令は実行中コンピユータの記憶レジスタに現れ、スイツチ及び
梯子回路網からの信号を選択された記憶ユニツトへとゲートするために用いられ
る。
（ト）　数値を異なる記憶ユニツトに出力するため第二のマルチプレクサスイツチ
が同様に付勢され、かつアナログ信号は第二の記憶ユニツトに転送される。このプ
ロセスは、各組のアナログ信号が異なるユニツトに記憶されるまで反復される。こ
のアナログ信号記憶方式は、それぞれのアナログ出力用にレジスタに加えてスイツ
チ及び梯子回路網を装備する方式に対して、汎用コンピユータと併用するために必
要な補助装置を更に節減することができる。
４　以上の認定事実を前提として、第二引用例記載の発明における構成〔２〕、
〔４〕、〔５〕についての本件審決の認定及び本願発明の構成②、④、⑤との同一
性についての本件審決の認定の当否を逐一検討する。
（一）　第二引用例記載の発明における構成〔２〕と本願発明の構成②との同一性
について
　前掲甲第四証によれば、第二引用例には、「ＦＩＧ１は汎用コンピユータ及びこ
れと連結された補助装置を示す構成図である。」（第二欄第一九行、第二〇行）、
「ＦＩＧ１を参照すると、汎用コンピユータの主要ユニツトが点線の矩形１０内の
素子によつて示してある」（同欄第二九行ないし第三一行）、「コンピユータ１０
はプログラムされた命令を実行する際、連続的な主状態を通過する。」（第三欄第
一三行、第一四行）と記載され、ＦＩＧ１（別紙図面（三）参照）には、本件審決
が周辺回路とするナンドゲート２２、マルチプレクサスイツチ２４、出力選択ロジ
ツク回路２５、デコーダ２６の各ブロツクは、点線の矩形１０の外側に置かれてお
り、汎用コンピユータの主要ユニツトとして示されていないことが認められるか
ら、本件審決が周辺回路を含めてコンピユータと認定したことは第二引用例でいう
「コンピユータ」とは異なる用語の使い方がされているということができる。
　しかしながら、周辺回路を含めて「コンピユータ」という用語を用いることは普
通になされていることであつて、このことは前掲甲第六号証によれば、本願明細書
でも、周辺回路である入力ポート２１、出力ポート２５を含めてプロセツサ２０と
称していること（第五頁第一四行ないし第一八行）が認められることから明らかで
ある（なお、前掲甲第六号証によれば、本願発明における「プロセツサ」は「コン
ピユータ」と同義であると認められる。）。
　したがつて、本件審決が周辺回路を含めてコンピユータと認定したのは、用語の
使い方にすぎず、この点に第二引用例記載の技術内容の誤認があるとすることはで
きない。
　そして、前掲甲第四号証によれば、第二引用例には、連続的な近似サブルーチン
を実行し、かつ出力されるべきアナログ値を受ける記憶ユニツトを選択するために
必要なコンピユータ・プログラムを示す記載（第七欄第三六行ないし第八欄第七
行）において、命令コード「ＳＬＡ」の説明として「アナログ入力が現在の累算器
の内容より大きい場合、次の命令を飛び越す」（第七欄第五〇行ないし第五三
行）、「アナログ入力が現在の累算器の内容より大きい場合は飛び越す。」（同欄
第六二行、第六三行）、「アナログ入力が大きい場合は飛び越す。」（同欄第七〇
行）と記載されており、一方、累算器１１の内容はスイツチ及び梯子回路網２０で
アナログ値に変換されて比較器１９に送られ、アナログ入力１８と比較され、比較
器１９の出力はナンドゲート２２に送られ、プログラム中の端子１７からのタイミ
ングパルスとの一致により定まる適時にスキツプ母線１６を起動する（第四欄第一
〇行ないし第二一行）から、「ＳＬＡ」は、比較器１９での比較結果により次のス
テツプを実行するか飛び越すかを命令するものであり、これをハードウエアの動作
でみれば、比較器１９からの信号がナンドゲート２２を介して与えられてコンピユ
ータのプログラムが実行されているものと認められ、したがつて、第二引用例記載
の発明においては、比較器からの信号がプログラムに従つてコンピユータに入力さ
れ処理されていることが明らかである。
　この点に関して、原告は、本願発明における「プロセツサ」は小形化された「マ
イクロコンピユータ」であつて、プロセツサ２０の外部にどのようなハードウエア
を配置させるかは重要な判断事項である旨主張するが、本願発明の特許請求の範囲
にはプロセツサを小形化された「マイクロコンピユータ」に限定する記載はないか
ら、右主張は本願発明の要旨に基づかないものであつて理由がない。
　また、原告は、第二引用例記載の発明にはナンドゲート２２が存することを理由
に、比較器からの信号をコンピユータに入力していない旨主張するが、ナンドゲー
ト２２がコンピユータの一要素として捉え得ることは前述のとおりであり、その存
在はプログラムの実行に何らかの支障となるものではないから、原告の右主張は理
由がない。
　さらに、原告は、第二引用例第七欄及び第八欄記載の「コンピユータプログラ
ム」は、アナログ入力の値をデイジタル値に変換するためのサブルーチンを示して
いて、装置全体の動作を示すプログラムでない旨主張するが、仮にそうであつて
も、コンピユータのプログラムがナンドゲート２２を介して実行されていることに
変わりがないのであるから、前記認定に何らの影響も与えるものではない。
　したがつて、第二引用例記載の発明は、メモリ部１１～１４を有し比較器１９か
らの出力信号を入力とするコンピユータ（１０及び周辺回路２２、２４、２５、２
６）を備え、メモリ部がプログラムやデータを記憶し、算術演算や論理演算をする
ものとした本件審決の認定に誤りはなく、この構成は、本願発明の構成②「プログ
ラムメモリ部と演算制御部とデータメモリ部とを有し前記比較器からの出力信号を
入力とするプロセツサ」と実質的に同一であることが明らかであるから、両者は右
構成において一致するとした本件審決の認定に誤りはない。
（二）　第二引用例記載の発明における構成〔４〕と本願発明の構成④の同一性に
ついて
　前掲甲第四号証によれば、第二引用例記載の発明において、出力選択ロジツク回
路２５からマルチプレクサスイツチ２４に与えられる信号は、デコーダ２６及びメ
モリバツフアレジスタ１２からのものであり（別紙図面（三）ＦＩＧ１参照）、こ
れらはいずれもコンピユータに含まれること前述のとおりであるから、右信号は
「コンピユータからの出力指令信号」ということができる。
　原告は、第二引用例記載の発明は、本願発明のようにコンピユータから直接出力
される出力指令信号（サンプリングパルス）により、Ｄ／Ａ変換器からの出力をア
ナログ信号保持手段に印加する構成になつていない旨、また、第二引用例記載の発
明のように、信号の経路の途中にデコーダ、出力選択ロジツク回路、マルチプレク
サスイツチ等が存在すれば動作タイミングや信号形態が本願発明と異なる旨主張す
るが、本願発明の特許請求の範囲には、出力指令信号がコンピユータから直接出力
されるものとの限定はなく、また、動作のタイミングや信号形態を規定する記載も
ないから、右主張は本願発明の要旨に基づかないものであつて理由がない。
　したがつて、第二引用例記載の発明は、スイツチ及び梯子回路網の出力信号をコ
ンピユータからの出力指令信号（アキユムレータ１１及びメモリバツフアレジスタ
１２からデコーダ２６、出力選択ロジツク回路２５を介してマルチプレクサスイツ
チ２４に与えられる信号）に従つてサンプル・ホールドするアナログ信号保持手段
２４、２３を有するとした本件審決の認定に誤りはなく、右スイツチ及び梯子回路
網がＤ／Ａ変換器であることは当事者間に争いがないから、この構成は、本願発明
の構成④「Ｄ／Ａ変換器の出力信号を前記プロセツサからの出力指令信号に従つて
サンプル・ホールドするアナログ信号保持手段を具備し」と実質的に同一であるこ
とが明らかであり、両者は右構成において一致するとした本件審決の認定に誤りは
ない。
（三）　第二引用例記載の発明における構成〔５〕と本願発明の構成⑤との同一性
について
　第二引用例記載の発明において、ナンドゲート２２がコンピユータに含まれるこ
とは、前記（一）認定のとおりである。そして、前掲甲第四号証によれば、右ナン
ドゲート２２は、タイミングパルス１７に依存しているが、コンピユータのプログ
ラムがナンドゲート２２を介して実行されており、このナンドゲート２２やタイミ
ングパルス１７がプログラムに従うコンピユータの動作の支障になるものでなく、
コンピユータはプログラムメモリ部に記憶されている信号に従つて入力アナログ信
号をデイジタル信号に変換する動作をしているものであることが認められる。
　原告は、第二引用例記載の発明においては、比較器１９の出力信号は外部からの
タイミングパルス１７によりその開閉が制御されるナンドゲート２２を介してコン
ピユータ１０に印加されているから、Ａ／Ｄ変換の動作がプログラムに従つて行わ
れていない旨主張するが、第二引用例記載の発明においてナンドゲート２２がプロ
グラムの実行の支障となるものでなく、ナンドゲート２２はコンピユータの一要素
として捉えられるものであること前述のとおりであるから、ナンドゲート２２の存
在を理由に、Ａ／Ｄ変換の動作がプログラムに従つて行われていないとする原告の
主張は理由がない。
　したがつて、第二引用例記載の発明は、コンピユータが前記プログラムに従つて
前記比較器、コンピユータ及びスイツチ及び梯子回路網で構成されるループによつ
て前記入力アナログ信号をデイジタル信号に変換するものとした本件審決の認定に
誤りはなく、この構成は本願発明の構成⑤「前記プロセツサは、前記プログラムメ
モリ部に記憶されている信号に従つて前記比較器、プロセツサ及びＤ／Ａ変換器で
構成されるループによつて前記入力アナログ信号をデイジタル信号に変換し」と実
質的に同一であることが明らかであり、両者は右構成において一致するとした本件
審決の認定に誤りはない。
（四）　本願発明と第二引用例記載の発明との作用効果の異同について
　本願発明がプロセツサの入力側に高価なＡ／Ｄ変換器を設ける必要がなく、全体
構成を簡単かつ安価にできるという作用効果を奏することは前記３（三）認定のと
おりであり、第二引用例記載の発明もこのような作用効果を奏するものであること
は、以上認定の構成及び第二引用例の記載（特に第一欄第一三行ないし第二欄第一
四行）から明らかである。
　原告は、本願発明は動作のすべてがプログラムメモリ部からの信号によつて行わ
れ、プロセツサの外部にＡ／Ｄ変換器やその他制御のための各回路を必要としない
点で第二引用例記載の発明と作用効果を異にする旨主張する。
　しかしながら、周辺回路を含めてコンピユータ（プロセツサ）と称することが普
通になされていることは前述のとおりであり、本願発明の前記構成②はプログラム
メモリ部と演算制御部とデータメモリ部等の機能部分を有していることを規定して
いるのみで、その特許請求の範囲全体を検討しても、プロセツサをどのような構造
のもので構成するのか規定していないから、本願発明がプロセツサの外部に制御の
ための各回路を必要としないとの原告の主張は、本願発明の要旨に基づかないもの
であつて理由がない。
５　以上のとおりであつて、本件審決には、前訴判決の拘束力ある判断に反した違
法、及び本願発明が第一引用例及び第二引用例記載の発明に基づき容易になし得た
ものであることについての拒絶理由通知を発しないでなされた違法は、いずれも存
せず、また、第二引用例記載の発明の〔２〕、〔４〕、〔５〕の構成と本願発明の
②、④、⑤の構成が一致するとした本件審決の認定は正当であり、第一引用例記載
の発明について検討するまでもなく、本願発明は第二引用例記載の発明に基づいて
当業者が容易になし得たというべきであるから、この点においても本件審決に原告
主張の違法は存しない。
三　よつて、本件審決の違法を理由にその取消しを求める原告の本訴請求は失当と
してこれを棄却し、訴訟費用の負担について、行政事件訴訟法第七条、民事訴訟法
第八九条の各規定を適用して主文のとおり判決する。
（裁判官　竹田稔　春日民雄　岩田嘉彦）
別紙図面（一）～（三）（省略）

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